变更摘要

此 PR 为算子执行框架新增 PCIE Through 功能相关的内部接口，主要目的是在检测到 tensor 地址位于 PCIE 地址范围时，跳过算子执行缓存（OpExecCache）的查找与写入，避免因 PCIE 通道数据变化导致缓存命中过期结果。变更涉及在 OpConfigInfo 中新增 usePcieAddr 标记字段、新增 op_feature_internal 模块提供 PCIE 地址检测能力，以及在算子缓存流程的关键路径上增加 PCIE 地址判断与缓存短路逻辑。

主要改动

• 新增 usePcieAddr 字段到 OpConfigInfo：在 include/nnopbase/opdev/op_config.h 中为 OpConfigInfo 结构体增加了 bool usePcieAddr{false} 成员，并在拷贝构造和赋值运算符中同步处理该字段，同时将 reserved 数组从 5 字节缩减为 4 字节以保持结构体大小不变。

• 新增 op_feature_internal 模块声明与实现：新增 src/nnopbase/common/inc/op_feature_internal.h 头文件和 src/nnopbase/common/utils/op_feature.cpp 实现文件，提供 InitPcieThroughInfo()、IsPcieThroughEnabled()、IsTensorAddrInPcieRange() 三个内部接口。当前使用占位地址段（0x1~0x2）进行框架验证，真实地址段待后续弱符号接口接入后填充。

• 缓存初始化/重置时清零 usePcieAddr：在 src/nnopbase/common/utils/op_cache.cpp 的 ResetCacheThreadLocal()、InitPTACacheThreadLocal()、InitExecutorCacheThreadLocal() 三个函数中增加 usePcieAddr = false 的重置逻辑，确保每次线程局部缓存初始化时标记处于干净状态。

• Tensor 地址登记时检测 PCIE 范围并置标记：在 AddTensorAddrToCachedList() 和 AddAclTensorToCachedList() 中，当 IsPcieThroughEnabled() 为真且 IsTensorAddrInPcieRange() 判定地址命中时，将线程局部上下文的 usePcieAddr 置为 true。

• 算子缓存查找与写入的 PCIE 短路逻辑：在 GetOpExecCache()（两个重载）中，若 usePcieAddr 为 true 则直接返回 nullptr 跳过缓存查找；在 AddOpExecCache() 中，若 usePcieAddr 为 true 则直接销毁传入的缓存对象并返回 false，阻止 PCIE 场景下写入缓存。

• 在 L2 初始化流程中触发 PCIE 信息初始化：在 src/nnopbase/composite_op/aclnn_engine/op_executor.cpp 的 InitL2Phase1Context() 函数开头调用 op::internal::InitPcieThroughInfo()，确保在每次 L2 算子执行上下文的初始化阶段完成 PCIE Through 相关全局状态的 std::call_once 初始化。

代码审查

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