RTL2GDS:基于 iEDA、yosys 和 magic-vlsi 的 RTL 转 GDSII 工具项目
Star
1
Fork
0
代码
介绍
代码
Issues
Pull Requests
流水线
Actions
讨论
Wiki
项目成员
9
分析
项目设置
Star
1
Fork
0
A tool to compile your RTL files into GDSII layouts.
master
分支
2
Tags
0
IDE
下载zip
Clone
README
项目介绍
A tool to compile your RTL files into GDSII layouts.
Verilog
130
提交数
定制我的领域
README
规则集
举报项目
举报项目