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openDACS

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精选项目
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由中科鉴芯(CASTest)和中国科学院计算技术研究所联合开发的一款扫描设计工具,支持全扫描替换和扫描缝合。

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A tool to compile your RTL files into GDSII layouts.

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A chip design flow with open-source EDA tools, PDKs

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An open-source EDA infracstructure and tools from Netlist to GDS for ASIC design.

  • A chip design flow with open-source EDA tools, PDKs

    Verilog
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    MulanPSL-2.0
    更新于 2025年11月18日
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  • 模拟电路优化算法

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    更新于 2025年11月18日
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  • 暂无简介

    Python
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    更新于 2025年11月18日
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  • 运算放大器自动化设计

    1
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    更新于 2025年11月18日
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  • 由工业和信息化部等主办、开放原子开源基金会承办、openDACS工作委员会联合承办,聚焦集成电路产业的数字设计、模拟设计、芯片制造、处理器设计自动化、生成式芯片设计等5个方向10个赛题,对促进产业高质量发展具有重要意义。

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    MulanPSL-2.0
    更新于 2025年11月18日
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  • 由中科鉴芯(CASTest)和中国科学院计算技术研究所联合开发的一款ATPG工具,支持全扫描电路、固定型故障的自动测试生成。

    Vyper
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    NOASSERTION
    更新于 2025年11月18日
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  • An open-source EDA infracstructure and tools from Netlist to GDS for ASIC design.

    C++
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    NOASSERTION
    更新于 2025年11月18日
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  • 由中科鉴芯(CASTest)和中国科学院计算技术研究所联合开发的一款扫描设计工具,支持全扫描替换和扫描缝合。

    C++
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    NOASSERTION
    更新于 2025年11月18日
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  • 由中科鉴芯(CASTest)和中国科学院计算技术研究所联合开发的一款JTAG插入工具,支持边界扫描插入。

    C++
    1
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    NOASSERTION
    更新于 2025年11月18日
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  • 设计验证与测试综合工具,由中科院计算所维护的开源项目

    Vyper
    1
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    NOASSERTION
    更新于 2025年11月18日
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